基于Quartus Prime的FPGA CPLD数…

本书以Altera公司全新推出的Quartus Prime 15.1为设计平台，结合大量的实例来介绍基于FPGA/CPLD数字系统的设计方法。书中的例子包含简单的数字逻辑电路实例、数字系统设计实例及复杂的数字控制系统设计实例，由浅深地介绍了采用Quartus Prime 15.1行数字系统发的设计流程、设计思想和设计技巧。
【作者】
周润景教授，中国电子学会高级会员，IEEE/EMBS会员，国家自然科学基金项目“高速数字系统的信号与电源完整性联合设计与优化”等多项*、省部级科研项目负责人，主要从事模式识别与智能系统、控制工程的研究与教学工作，具有丰富的教学与科研经验。