为你推荐
前言
第1章 引论
1.1 集成电路发展史简介
1.2 国内集成电路的发展现状
1.3 国际集成电路的发展态势
1.4 静态时序分析技术
1.4.1 静态时序分析简介
1.4.2 静态时序分析背景
1.4.3 静态时序分析的优缺点
1.5 主流静态时序分析与建模工具介绍
第2章 静态时序分析的基础知识
2.1 逻辑门单元
2.2 门单元的时序计算参数
2.3 时序单元相关约束
2.4 时序路径
2.5 时钟特性
2.6 时序弧
2.7 PVT环境
2.8 时序计算单位
第3章 单元库时序模型
3.1 基本时序模型简介
3.2 Synopsys工艺库模型
3.3 延时计算模型
3.4 互连线计算模型
3.4.1 互连线计算模型
3.4.2 线负载时序模型
3.5 引脚电容值的计算
3.6 功耗模型的计算
3.7 时序信息建模基本方法
第4章 时序信息库文件
4.1 非线性延时模型
4.1.1 库组
4.1.2 因子
4.1.3 输入电压组
4.1.4 输出电压组
4.1.5 功耗查找表模板组
4.1.6 操作条件组
4.1.7 线负载组
4.1.8 延时查找表模板组
4.1.9 单元组
4.1.10 引脚组
4.1.11 触发器组
4.1.12 逻辑状态表组
4.1.13 电源引脚组
4.1.14 延时组
4.1.15 单元上拉延时组
4.1.16 单元下拉延时组
4.1.17 上拉转换组
4.1.18 下拉转换组
4.1.19 上拉约束组
4.1.20 下拉约束组
4.1.21 内部功耗组
4.1.22 哑阈漏流功耗组
4.2 复合电流源延时模型
4.2.1 输出电流查找表模板组
4.2.2 输出上拉电流组
4.2.3 输出下拉电流组
4.2.4 向量组
4.2.5 接收电容组
第5章 静态时序分析的基本方法
5.1 时序图
5.2 时序分析策略
5.3 时序路径延时计算方法
5.4 时序路径的分析方法
5.5 时序路径分析模式
5.5.1 单一分析模式
5.5.2 最好-最坏分析模式
5.5.3 芯片变化相关分析模式
5.6 时序减免
5.7 其他芯片变化相关分析模式
5.8 时钟路径悲观移除
5.9 时序优化
第6章 时序约束
6.1 时钟约束
6.1.1 创建时钟
6.1.2 生成时钟
6.1.3 虚拟时钟
6.1.4 最小时钟脉宽
6.2 I/O延时约束
6.3 I/O环境建模约束
6.4 时序例外
6.5 恒定状态约束
6.6 屏蔽时序弧
6.7 时序设计规则约束
第7章 串扰噪声
7.1 噪声的定义
7.2 噪声的来源
7.3 噪声恶化的原因
7.4 噪声的体现形式
7.5 噪声相互作用形式
7.6 NLDM噪声模型的计算
7.7 噪声延时计算方法
7.8 时间窗口
7.9 优化噪声的物理方法
7.10 CCS噪声模型
第8章 单元时序建模实战
8.1 时序信息提取实现
8.1.1 时序信息特征化实现流程
8.1.2 时序信息特征化数据准备
8.1.3 标准单元时序信息提取
8.2 SiliconSmart工具的使用流程简介
8.3 时序信息提取内容
第9章 静态时序分析实战(ETS篇)
9.1 静态时序分析的基本流程
9.2 建立静态时序分析的工作环境
9.3 静态时序分析实现
9.3.1 建立时间分析
9.3.2 保持时间分析
9.3.3 时序设计规则分析
9.3.4 时序违反修复
第10章 Tcl脚本编程
10.1 Tcl语法
10.1.1 命令格式
10.1.2 替换
10.1.3 双引号和花括号
10.1.4 注释
10.2 数据结构
10.2.1 简单变量
10.2.2 数组
10.3 表达式
10.3.1 操作数
10.3.2 运算符和优先级
10.3.3 数学函数
10.3.4 列表集合
10.4 控制流
10.4.1 if命令
10.4.2 循环命令
10.5 eval命令
10.6 source命令
10.7 过程
10.7.1 过程定义和返回值
10.7.2 局部变量和全局变量
10.7.3 默认参数和可变个数参数
10.8 引用
10.9 字符串操作
10.10 文件访问
10.10.1 文件名
10.10.2 基本文件输入/输出命令
第11章 Tcl脚本编程应用实例(PT篇)
11.1 get_failing_paths_high_slew
11.2 get_interclock_skew
11.3 report_unclocked
11.4 get_buffers
11.5 get_ports_edge_sense
11.6 report_clock_endpoint_skew
11.7 report_violations
11.8 eco_fix_violations
附录
参考文献
买过这本书的人还买过
读了这本书的人还在读
同类图书排行榜